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Questão FC266541

Com relação aos processadores superescalares e superpipeline., analise as afirmativas a seguir. I. Arquitetura superescalar - constitui uma técnica de implementação que permite que

Processador

IDECAN · 2021

Com relação aos processadores superescalares e superpipeline., analise as afirmativas a seguir.

 

I. Arquitetura superescalar - constitui uma técnica de implementação que permite que várias instruções sejam iniciadas simultaneamente e executadas independentemente uma das outras.

 

II. Arquitetura superpipeline - constitui uma técnica para atingir alto desempenho no processamento, pois explora o fato de que alguns estágios de pipeline executam tarefas que requerem menos de meio ciclo de clock, o que acarreta velocidade de clock dobrada, com aumento no desempenho por ter duas tarefas executadas em um único ciclo de clock.

 

III. A execução de programas em arquiteturas superescalar e superpipeline apresentam uma diminuição de throughput, que é o número de tarefas concluídas por unidade de tempo, e com isto passa a existir uma queda de desempenho.

 

Assinale

  1. se somente as afirmativas I e III estiverem corretas.
  2. se somente as afirmativas I e II estiverem corretas.
  3. se somente as afirmativas II e III estiverem corretas.
  4. se nenhuma afirmativa estiver correta.
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Gabarito

B

Comentário do professor

Superescalar: é uma técnica de implementação que permite iniciar e executar **várias instruções simultaneamente** usando múltiplas unidades funcionais. Cada instrução pode progredir independentemente, sujeita a dependências e conflitos de recursos; por isso são usados escalonadores e mecanismos como execução fora de ordem para maximizar paralelismo.

Superpipeline: consiste em dividir o pipeline em mais estágios menores, reduzindo o tempo de cada estágio e permitindo aumentar a frequência de clock. Com estágios menores, a CPU pode operar com clock mais alto e assim elevar o desempenho global, pois o número de instruções completadas por unidade de tempo tende a aumentar, mesmo que a latência por instrução possa variar.


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