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Questão FC406326

Texto I Os Processadores Digitais de Sinais (DSPs) são componentes fundamentais presentes em uma ampla gama de aplicações, abrangendo desde sistemas de comunicações sem fio e proce

Questões sem classificação de assunto (TI - Organização e Arquitetura dos Computadores)

FGV · 2024

Texto I

 

Os Processadores Digitais de Sinais (DSPs) são componentes fundamentais presentes em uma ampla gama de aplicações, abrangendo desde sistemas de comunicações sem fio e processamento de áudio até aplicações em imagens médicas e automotivas. Eles são projetados especificamente para manipular sinais digitais em tempo real, oferecendo capacidades de processamento eficientes e otimizadas para tarefas como filtragem, modulação, demodulação e análise de sinais.

 

A seguir, é apresentada uma lista comparativa entre cinco processadores de arquiteturas semelhantes, na qual são fornecidas informações sobre a faixa de frequência de operação do DSP, o número de MIPS (milhões de instruções por segundo) por MHz (frequência de operação do DSP) e a potência por instrução MIPS.

 

- DSP-P1: 300-750 Mhz; 3 MIPS/MHz; 0,15 mW/MIPS

- DSP-P2: 500-600 Mhz; 6 MIPS/MHz; 0,30 mW /MIPS.

- DSP-P3: 200-300 Mhz; 5 MIPS/MHz; 0,10 mW/MIPS.

- DSP-P4: 160-400 Mhz; 2 MIPS/MHz; 0,20 mW/MIPS.

- DSP-P5: 300-900 Mhz; 8 MIPS/MHz; 0,25 mW/MIPS.

 

Obs.: Considere que o número de instruções e a potência por MHz permanecem inalterados dentro da faixa de operação de frequências de cada processador.

 

Assinale a opção que indica o DSP que exibe o menor consumo de potência por MHz.

  1. DSP-P1.
  2. DSP-P2.
  3. DSP-P3.
  4. DSP-P4.
  5. DSP-P5.
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Gabarito

D

Comentário do professor

DSP-P4 apresenta o menor consumo de potência por MHz do conjunto. Para obter esse valor calcula-se: mW/MHz = (MIPS/MHz) × (mW/MIPS).

Aplicando aos dados do DSP-P4: \(2\ \text{MIPS/MHz} \times 0{,}20\ \text{mW/MIPS} = 0{,}40\ \text{mW/MHz}\).

Portanto, o DSP-P4 consome **0,40 mW por MHz**, resultado que o torna o de menor consumo por unidade de frequência entre os processadores apresentados. Essa eficiência decorre da combinação de um número baixo de instruções por MHz e um consumo por instrução moderado.

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